1.3.1硬件1.3.1基于总线的微型计算机硬件系统1.3.1基于总线的微型计算机硬件系统图1.3微型计算机硬件系统结构所谓总线，是计算机中各功能部件间传送信息的公共通道，是微型计算机的重要组成部分。它们可以是带状的扁平电缆线，也可以是印刷电路板上的一层极薄的金属连线。所有的信息都通过总线传送。根据所传送信息的内容与作用不同，总线可分为三类：地址总线AB(AddressBus)：在对存储器或I/O端口进行访问时，传送由CPU提供的要访问存储单元或I/O端口的地址信息，以便选中要访问的存储单元或I/O端口，是单向总线。数据总线DB(DataBus)：从存储器取指令或读写操作数，对I/O端口进行读写操作时，指令码或数据信息通过数据总线送往CPU或由CPU送出，是双向总线。控制总线CB(ControlBus)：各种控制或状态信息通过控制总线由CPU送往有关部件，或者从有关部件送往CPU。CB中每根线的传送方向是一定的，图1.3中CB作为一个整体，用双向表示。1.3.2微处理器1．运算器运算器又称算术逻辑单元ALU(ArithmeticLogicUnit)，用来进行算术或逻辑运算以及移位循环等操作。参加运算的两个操作数一个来自累加器A(Accumulator)，另一个来自内部数据总线，可以是数据缓冲寄存器DR(DataRegister)中的内容，也可以是寄存器阵列RA(RegisterArray)中某个寄存器的内容。计算结果送回累加器A暂存。2.控制器控制器又称控制单元CU(ControlUnit)，是全机的指挥控制中心。它负责把指令逐条从存储器中取出，经译码分析后向全机发出取数、执行、存数等控制命令，以保证正确完成程序所要求的功能。(1)指令寄存器IR(InstructionRegister)：用来存放从存储器取出的将要执行的指令码。当执行一条指令时，先把它从内存取到数据缓冲寄存器DR中，然后再传送到指令寄存器IR中。(2)指令译码器ID(InstructionDecoder)：用来对指令寄存器IR中的指令操作码字段（指令中用来说明指令功能的字段）进行译码，以确定该指令应执行什么操作。(3)可编程逻辑阵列PLA(ProgrammableLogicArray)：用来产生取指令和执行指令所需要的各种微操作控制信号，并经过控制总线CB送往有关部件，从而使计算机完成相应的操作。3.内部寄存器阵列2)地址寄存器AR(AddressRegister)：地址寄存器用来存放正要取出的指令的地址或操作数的地址。由于在内存单元和CPU之间存在着操作速度上的差异，所以必须使用地址寄存器来保持地址信息，直到内存的读/写操作完成为止。在取指令时，PC中存放的指令地址送到AR，根据此地址从存储器中取出指令。在取操作数时，将操作数地址通过内部数据总线送到AR，再根据此地址从存储器中取出操作数；在向存储器存入数据时，也要先将待写入数据的地址送到AR，再根据此地址向存储器写入数据。3)数据缓冲寄存器DR(DataRegister)数据缓冲寄存器用来暂时存放指令或数据。从存储器读出时，若读出的是指令，经DR暂存的指令经过内部数据总线送到指令寄存器IR；若读出的是数据，则通过内部数据总线送到运算器或有关的寄存器。同样，当向存储器写入数据时，也首先将其存放在数据缓冲寄存器DR中，然后再经数据总线送入存储器。可以看出，数据缓冲寄存器DR是CPU和内存、外部设备之间信息传送的中转站，用来补偿CPU和内存、外围设备之间在操作速度上存在的差异。4)寄存器阵列(RegisterArray)若干通用和专用的寄存器，其设置与微处理器型号有关。5)累加器A(Accumulator)累加器是使用最频繁的一个寄存器。在执行算术逻辑运算时，它用来存放一个操作数，而运算结果通常又放回累加器，其中原有信息随即被破坏。所以，顾名思义，累加器是用来暂时存放ALU运算结果的。显然，CPU中至少应有一个累加器。目前CPU中通常有很多个累加器。当使用多个累加器时，就变成了通用寄存器堆结构，其中任何一个既可存放目的操作数，也可以放源操作数。例如本书介绍的80x86系列CPU就采用了这种累加器结构。6)标志寄存器FLAGS（FlagRegister）标志寄存器有时也称为程序状态字PSW(ProgramStatusWord)。它用来存放执行算术运算指令、逻辑运算指令或测试指令后建立的各种状态码内容以及对CPU操作进行控制的控制信息。标志位的具体设置及功能随微处理器型号的不同而不同。编写程序时，可以通过测试有关标志位的状态（0或1）来决定程序的流向。1.4.3存储器这里介绍的存储器是指内存储器（又称为主存或内存）。它是微型计算机的存储和记忆装置，用来存放指令、原始数据、中间结果和最终